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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

发表于 2021-10-10 01:18:32 | 显示全部楼层

看看，隐藏，，，

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发表于 2021-10-10 07:10:16 | 显示全部楼层

thanks you

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发表于 2021-10-10 17:43:53 | 显示全部楼层

niuya

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发表于 2021-10-12 10:19:14 | 显示全部楼层

多谢多谢

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腹黑的麦田

发表于 2021-10-12 10:40:04 | 显示全部楼层

thanks

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发表于 2021-10-13 10:55:46 | 显示全部楼层

thanks

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发表于 2021-10-13 16:07:54 | 显示全部楼层

楼主厉害

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发表于 2021-10-20 10:28:05 | 显示全部楼层

Thanks

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发表于 2021-10-20 19:53:36 | 显示全部楼层

xiexie dalao

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发表于 2021-10-21 10:17:31 | 显示全部楼层

谢谢分享

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