求助,学习数字用verilog还是vhdl

guoyu · 发表于 2007-10-21 13:21:36

如果你偏重芯片设计的话就用Verilog。

木叶清风 · 发表于 2007-10-24 16:05:42

vhdl初级，verilog商业开发

pennynet · 发表于 2007-10-24 23:30:47

还是好好学verilog吧,
个人感觉verilog较好,
以前在学校学的vhdl入门,
后来工作在公司都用的verilog,
感觉verilog好很多,同样的内容verilog短洁的多,
例化简单,方便.

不过还是有很多欧洲公司用vhdl,
比如英飞凌,
美国,台湾,包括大陆大部分公司都用的verilog

hitler1029 · 发表于 2007-10-25 23:51:29

verilog

lufeng2008pk · 发表于 2007-10-31 20:07:47

正在学习verilog中

ljjvip · 发表于 2007-11-1 09:23:12

用VERILOG 上手比较快。

kenpachi11 · 发表于 2011-2-9 00:02:14

谢谢分享

jasonL · 发表于 2011-2-20 16:54:56

i prefer verilog...

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