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想用Altera CPRI IP生成数据通过ALTGX高速接口发送出去。
但是端口很多,不知道每个端口具体负责哪块功能。
有没有完整的应用的实例能参考一下。要有详细的复位时序。
cpri_protocal cpri_protocal(
input wire clk_ex_delay, // clk_ex_delay.clk
input wire reset_ex_delay, // reset_ex_delay.reset
input wire cpu_clk, // cpu_clk.clk
input wire cpu_reset, // cpu_reset.reset
input wire [31:0] cpu_writedata, // cpu.writedata
input wire [3:0] cpu_byteenable, // .byteenable
input wire cpu_read, // .read
input wire cpu_write, // .write
output wire [31:0] cpu_readdata, // .readdata
input wire [13:0] cpu_address, // .address
output wire cpu_waitrequest, // .waitrequest
output wire [11:0] extended_rx_status_data, // extended_rx_status.data
output wire cpri_clkout, // cpri_clkout.export
output wire cpu_irq, // cpu_irq.export
output wire [4:0] cpu_irq_vector, // cpu_irq_vector.data
output wire [75:0] aux_rx_status_data, // aux_rx_status_data.data
output wire [43:0] aux_tx_status_data, // aux_tx_status_data.data
input wire [64:0] aux_tx_mask_data, // aux_tx_mask_data.data
input wire gxb_refclk, // gxb_refclk.export
input wire gxb_pll_inclk, // gxb_pll_inclk.export
output wire gxb_pll_locked, // gxb_pll_locked.export
output wire gxb_rx_pll_locked, // gxb_rx_pll_locked.export
output wire gxb_rx_freqlocked, // gxb_rx_freqlocked.export
output wire [3:0] gxb_rx_errdetect, // gxb_rx_errdetect.export
output wire [3:0] gxb_rx_disperr, // gxb_rx_disperr.export
input wire gxb_los, // gxb_los.export
output wire gxb_txdataout, // gxb_txdataout.export
input wire gxb_rxdatain, // gxb_rxdatain.export
input wire reconfig_clk, // reconfig_clk.export
output wire pll_clkout, // pll_clkout.export
input wire reset, // reset.export
output wire reset_done, // reset_done.export
input wire config_reset, // config_reset.export
input wire hw_reset_assert, // hw_reset_assert.export
output wire hw_reset_req, // hw_reset_req.export
output wire datarate_en, // datarate_en.export
output wire [4:0] datarate_set, // datarate_set.export
output wire cpri_mii_txclk, // cpri_mii_txclk.export
output wire cpri_mii_txrd, // cpri_mii_txrd.export
output wire cpri_mii_rxclk, // cpri_mii_rxclk.export
output wire cpri_mii_rxwr, // cpri_mii_rxwr.export
output wire cpri_mii_rxdv, // cpri_mii_rxdv.export
output wire cpri_mii_rxer, // cpri_mii_rxer.export
output wire [3:0] cpri_mii_rxd, // cpri_mii_rxd.export
input wire cpri_mii_txen, // cpri_mii_txen.export
input wire cpri_mii_txer, // cpri_mii_txer.export
input wire [3:0] cpri_mii_txd, // cpri_mii_txd.export
input wire [3:0] reconfig_togxb_m, // reconfig_togxb_m.export
output wire [4:0] reconfig_fromgxb_m, // reconfig_fromgxb_m.export
input wire reconfig_busy, // reconfig_busy.export
input wire reconfig_write, // reconfig_write.export
input wire reconfig_done, // reconfig_done.export
input wire gxb_cal_blk_clk, // gxb_cal_blk_clk.export
input wire gxb_powerdown // gxb_powerdown.export
); |
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