spare gates怎么加

yuanpin318 · 发表于 2018-5-21 21:44:54

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IC设计时，总要加一些spare gate.

具体应该怎么做？

RTL代码怎么处理？

Synthesis怎么处理？

FLoor plan 以及 P&R怎么处理？

vitohong · 发表于 2018-5-22 10:23:52

合成的時候加入don't touch spare cell那段設定
netlist就會出現

orlye · 发表于 2018-5-22 15:03:35

没什么特殊要求的话，前端不管这事儿，出方案让后端加。
要绑定模块的话，前端加好了，dont_touch，让后端摆在绑定的模块附近

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