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查看: 7918|回复: 7

关于IP核的顶层仿真文件testbench,应该如何写

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发表于 2007-8-27 15:26:33 | 显示全部楼层 |阅读模式

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我在底层文件里,添加了2个除法器的IP核,想仿真一下,但是不知道testbench怎么写?望高人指点?

我的底层文件是这样写的:

module test(clk,
                  divisor1,divisor2,  
                  dividend1,dividend2,  
                  quotient1,quotient2,
                   remainder1,remainder2,
                   rfd1,rfd2,);
  

  input clk;
    input [15:0] divisor1,divisor2;
    input [15:0] dividend1,dividend2;
    output [15:0] quotient1,quotient2;
    output [15:0] remainder1,remainder2;
    output rfd1,rfd2;
  

  
divider d1(
.clk(clk),
.dividend(dividend1),
.divisor(divisor1),
.quotient(quotient1),
.remainder(remainder1),
.rfd(rfd1)
);


divider d2(
.clk(clk),
.dividend(dividend2),
.divisor(divisor2),
.quotient(quotient2),
.remainder(remainder2),
.rfd(rfd2)
);


endmodule

请问:顶层仿真文件testbench该如何写?
 楼主| 发表于 2007-8-27 19:25:56 | 显示全部楼层
我顶
发表于 2007-8-31 11:01:44 | 显示全部楼层
testbench跟是不是IP没有关系,你要根据IP实现的功能来写。。。。。。。。sigh
发表于 2007-9-3 11:44:05 | 显示全部楼层
找一个标准的testbench对着写就行了,无非是由以下几部分组成:
(1)例化你所需要测试的模块。
(2)生成输入激励,包括:时钟信号与数据信号。
(3)检查响应对不对。
具体就靠自己学了
发表于 2007-9-16 20:34:21 | 显示全部楼层
找一个标准的testbench对着写就行了,无非是由以下几部分组成:
(1)例化你所需要测试的模块。
(2)生成输入激励,包括:时钟信号与数据信号。
(3)检查响应对不对。
具体就靠自己学了

言简意赅啊!强!
发表于 2007-9-23 10:08:22 | 显示全部楼层
建议先看一下IPcore的datasheet,上面有各个信号的定义
发表于 2010-8-1 21:13:21 | 显示全部楼层
谢谢~~~~~
发表于 2018-12-18 22:12:57 | 显示全部楼层
学习中。。。。。。。。。。。。。。。
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