clock gating

汗不敢出 · 发表于 2007-7-8 17:17:07

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manual上说clock gating 会产生clock glitch或 clipped clock.一直不太理解．
请大侠帮忙解释一下．ＴＨＡＮＫＳ

mzsm1 · 发表于 2007-7-9 11:12:55

时钟的开关在切换时会产生glitch

[ 本帖最后由 mzsm1 于 2007-7-9 11:14 编辑 ]

sand_xiong · 发表于 2007-7-20 03:11:24

不是太懂.......

denap · 发表于 2007-8-13 22:08:29

Thanks for sharing!!!

even_ryen · 发表于 2007-8-17 21:34:24

matrixwayne · 发表于 2008-8-11 23:03:04

恩，对头！！！！

zhuzhaomin · 发表于 2008-8-29 17:00:07

我想clock gating是为了降低功耗吧，就是clock脉冲会消耗电力，而不工作时就让时钟停走，即gate the clock.

vwxy420 · 发表于 2008-8-29 23:50:34

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sevid · 发表于 2008-9-19 23:48:14

clock gating can enable and unable the clock to the module when it neednot to run.
so it can save power consumption.
but clock glitch ?

522526tl · 发表于 2014-11-6 20:56:06

回复 1# 汗不敢出

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