想把自己的一个模块设计为一个IP核，应该用什么工具进行封装、打包？？？

oulong · 发表于 2007-7-4 17:42:53

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很想知道有没有什么工具进行ＩＰ核的设计
原来ＩＳＥ５．１有个叫ＩＰ　Ｃａｐｔｕｒｅ　的工具可以进行封装、打包
但ＩＳＥ７．１就没有这个工具了

哪位大虾给指点一下，先谢了！！！！

kascal · 发表于 2007-12-29 14:56:29

我也想知道啊。

shangubujing · 发表于 2008-2-29 15:08:49

me too !!!

loveineda · 发表于 2008-2-29 16:20:21

原帖由 oulong 于 2007-7-4 17:42 发表

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很想知道有没有什么工具进行ＩＰ核的设计
原来ＩＳＥ５．１有个叫ＩＰ　Ｃａｐｔｕｒｅ　的工具可以进行封装、打包
但ＩＳＥ７．１就没有这个工具了

哪位大虾给指点一下，先谢了！！！！

ip要经过非常仔细的验证过的!!
看来你自己才是大虾哦,验证过程和思想跟我讲讲,我想了解!!!

[ 本帖最后由 loveineda 于 2008-2-29 16:27 编辑 ]

yuanpin318 · 发表于 2008-2-29 17:40:17

Are you talking to FPGA?

kplwqx · 发表于 2011-3-28 14:58:49

学习下

jsjdezqh · 发表于 2011-5-27 09:55:31

这个确实没了，好像得用第三方工具~~~

ee_designer · 发表于 2011-5-27 10:00:46

如果我要买一个IP，我希望：
通过验证环境进行全面的case验证，进过实际测试，有完备的仿真，综合等环境脚本，基本功能和使用手册等文档，接口总线封装根据我的要求进行定制

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