慢时钟域采样快时钟域信号

analog大魔头 · 发表于 2017-7-19 11:17:37

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有两个时钟域 clka :1M，clkb：50M，能实现用1M慢时钟域去采样50M快时钟域的信号吗？

江山无限辉 · 发表于 2017-7-19 12:20:03

可以呀，让50M产生的信号产生一个大于1us（1M）的电平，然后再用1M时钟去捕获这个电平或者捕获这个大于1us信号的沿。

rayslike · 发表于 2017-7-19 15:22:25

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swary · 发表于 2017-7-20 08:31:42

常用方法是将快时钟域信号展宽，通过反馈电路将信号再拉低，完成快时钟到慢时钟的转换。

fkl523 · 发表于 2017-7-20 08:40:14

回复 4# swary

简洁准确，谢谢。

江山无限辉 · 发表于 2017-7-20 08:56:07

看看，学习学习

analog大魔头 · 发表于 2017-7-20 10:49:53

回复 2# 江山无限辉

谢谢，学习了。后来查看RTL级发现是快256m对慢50m时钟采样，然后设置Multicycle Hold 后，为什么不顶用。

gaurson · 发表于 2017-7-20 14:58:01

clk_50m和后面的那个时钟是同步还是异步？

analog大魔头 · 发表于 2017-7-20 15:48:14

回复 8# gaurson

经过了一个PLL ，慢的时钟是参考时钟，生成的是快时钟，然后快对慢采样

gaurson · 发表于 2017-7-21 13:51:55

有没有把这两个时钟放到一个clock group里面？我理解这样就是同步的吧。不能当做异步去分析。

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