在做floorplan时，channel中用加tap cell 吗？

xingyun666666 · 发表于 2017-5-15 20:04:25

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莫名晴天 · 发表于 2017-5-15 22:56:10

是tsmc的库吗？如果是是要加的，而且必须加，否则drc还是lvs过不了。哪怕channel中没有逻辑器件，只有decap

EDWARDKING · 发表于 2017-5-15 23:23:56

需要放置std cell的地方都需要加tap cell

xingyun666666 · 发表于 2017-5-16 09:37:31

回复 2# 莫名晴天

是smic的库，
1.为什么lvs过不了？不太懂，可以解释下吗？
2.为什么就算有decap cell，decap cell也需要tap cell吗？但是endcap cell可以不加吧？

xingyun666666 · 发表于 2017-5-16 09:41:38

本帖最后由 xingyun666666 于 2017-5-17 09:37 编辑

回复 3# EDWARDKING

受教了，请问，endcap在channel需要加吗？

idanceu · 发表于 2017-5-16 11:13:00

tapless工艺，放std cell的区域都要加tap cell进行偏置，不加的话drc会过不了，lvs一般也会检查floating well。

xingyun666666 · 发表于 2017-5-16 14:52:56

回复 6# idanceu

还有一个疑问,MEM之间为了优化tran或者timing留的channel，在这个channel中用加endcap吗？为什么？

xingyun666666 · 发表于 2017-5-17 09:38:44

顶一下,不懂啊

idanceu · 发表于 2017-5-17 16:45:54

本帖最后由 idanceu 于 2017-5-17 16:47 编辑

回复 7# xingyun666666
跟工艺相关，有些工艺要求row两端必须加，不加会有poly相关drc，你说的channel是row的话就要加.

xingyun666666 · 发表于 2017-5-18 09:44:15

回复 9# idanceu

是竖直方向,两列macro之间形成的channal，留这个channal是为了以后解timing，但是发现贴着这两列macro加了两列endcap，不知道是不是这里没必要加？应该加吗？

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