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楼主: suly

[讨论] 模拟版图工程师的职业前景大讨论!!!各位速进

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发表于 2016-7-21 09:20:43 | 显示全部楼层
回复 20# okfunny


   敢问楼主是做模拟还是数字后端,做模拟可以做这么长时间吗?感觉模拟是吃青春饭的,老了也没这个精力做了。楼主可以在海思做这么久,也是不一般的人了!
 楼主| 发表于 2016-7-21 13:16:00 | 显示全部楼层
回复 20# okfunny


    很钦佩你的职业精神,能够一直在学习一直在进步,如果一直有进取心一直有目标,那就一直做下去呗,加油
 楼主| 发表于 2016-7-21 13:17:46 | 显示全部楼层
回复 21# keenkeen


    我之前有个同事快四十岁了也在做模拟layout,也是一线工程师,但是他的情况比较特殊,之前下海去做别的行业做了几年,然后又回来的,这种情况还是比较少见的
发表于 2016-7-21 19:02:51 | 显示全部楼层
回复 21# keenkeen


我是做模拟版图的。我接触的老外,做二十几年的都有,都是经验非常丰富的。
国内的话如果只是画画版图,一般的认识确实只是吃青春饭。
我们现在做的很重要的事情就是扩大版图人员的工作范围,提升存在感,提升我们在整个开发流程中的地位
发表于 2016-7-21 19:22:39 | 显示全部楼层
以前在哪本书看到,欧美等国家模拟IC前端designer设计好电路后自己去画版图,也就是电路和版图是同一个人去完成,国外很少有专职的版图工程师,不知是否属实?
发表于 2016-7-21 19:27:36 | 显示全部楼层
回复 24# okfunny

我们公司经常雇佣一个版图工程师,他原来是做RF,后来转行画版图。
时薪在100欧元左右(税前,他自己开了一个个人公司,专门接版图的外包。)
他画版图不仅很快,有时候还会反过来虐经验不多的电路工程师。指出设计中的不足。
例如缺少dummy,输入管面积太小,噪声或者mismat比较大等等。


模拟版图如果要手画,那么的确是很累。
但是随着经验的积累,特别是自己编写合适的脚本,那么效率会大幅度的提高。
毕竟对齐,放via等操作站比例很大。

另外就是Cadence 6里面对版图绘制有了很大很大的加强。
如果你熟悉了一般的功能,那真的就是轻松很多。
特别是constrain driven design。很多模块都可以自动生成了。

我是模拟电路工程师。但有时候都想转行去画版图了。
只要质量好,接外包的活都赚的不少。
发表于 2016-7-21 19:30:49 | 显示全部楼层
回复 25# zouxinfeng95321

看具体的公司,以及部门。
两种情况都有。

但是作为模拟电路工程师,一定是要懂版图的。
另外在Cadence 6里面,通过constrain,可以很方便的生成特定电路的版图。
例如input pair, current mirror等等。
这就使得电路工程师对版图参与度更高。
发表于 2016-7-21 20:03:47 | 显示全部楼层




    Virtuoso XL和Laker等EDA软件的一些先进功能确实减少了版图工程师的一些繁琐工作量,大学刚毕业时做版图工作时确实有一些激情,但是做了几年后,越来越兴趣减少了,有些项目芯片面积很大,5、6层金属走线,最累的就是眼睛了,加班画一天版图后视力稍微有所下降,因为画版图时屏幕不断在刷新,很多做模拟版图的工程师都想转模拟IC前端designer,只是很多人由于学历或者技术积淀等原因转前端设计有些难,前端想转版图的似乎不是太多
发表于 2016-7-21 20:56:17 | 显示全部楼层
回复 25# zouxinfeng95321


   我接触的老外团队都是有专职的版图人员的,即使电路人员对版图很熟悉,但是也不会自己做,因为版图要考虑的细节太多了,毕竟分工的效率更高
 楼主| 发表于 2016-7-22 09:36:31 | 显示全部楼层
回复 28# zouxinfeng95321


    从版图转到schematic designer的确实很少,一般版图工程师都是本科毕业,电路的designer起码都是硕士毕业,倒不是说本科就比硕士差多少,但就拉扎维那本书来说,本科学的确实有限,一般研究生才会全部学完,这就造成版图工程师对电路的理解普遍不够,当然后期工作中如果自己有恒心去学习一下的话还是有转到前端的机会,我有个同学就是本科毕业做版图两年后来转到前端做电路的designer了
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