环形vco收敛性问题

wang1991 · 发表于 2016-7-1 15:40:28

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环形vco仿真瞬态不起振，看到论坛里面的人说在tran里面的option里面有个skip dc选上yes可以，我试了下果然可以，但是后仿发现还是不行，不能起振，想问下论坛里面的大牛，这个skip dc是个什么原理，hspice里面有对应的设置吗？

bright_pan · 发表于 2016-7-1 16:26:09

上电速度慢一点呢？

semico_ljj · 发表于 2016-7-1 16:49:35

回复 1# wang1991

怎么上电的？

rong00i8 · 发表于 2016-7-1 17:01:10

不要skip dc
确认gain以及设计没问题，跑上电就可以

wang1991 · 发表于 2016-7-2 09:39:16

回复 2# bright_pan
上电速度慢一点是什么意思呢？是不是让电源电压用pwl线性升上去呢？能否给解释下这个和上电速度有什么关系呢?谢谢您

wang1991 · 发表于 2016-7-2 09:40:32

回复 3# semico_ljj

就是正常上电的，在零时刻就将电源和地电位加上去，请问这个上电有关系吗？能否解释下，谢谢您

wang1991 · 发表于 2016-7-2 09:45:29

回复 4# rong00i8

其实我也不知道这个skip dc是什么个原理，如果不选上的话确实是不能起振的，我用stb跑的环路增益在低频的时候有40db，在目标的振荡频率也有20多个db，不应该振不起来，您说的跑上电意思是电源电压缓慢升上去吗？还是什么其他的办法？和上电速度为什么有关系呢？还望多多指教，谢谢您

jqsun · 发表于 2016-7-2 11:10:31

仿真毕竟是仿真，这个东西是亚稳态的，相当于加上一个刺激脱离亚稳态使起震

wang1991 · 发表于 2016-7-2 11:18:53

回复 8# jqsun

是不是说一般测试都是能够起振的，我现在的情况是后仿怎么设置都不振，环形的VCO毕竟后仿频率会掉很多，所以想后仿和前仿对比下

quhuaibo · 发表于 2016-7-2 12:38:00

good information

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