Xilinx Artix7 ac701 电路图资料

peter.zh · 发表于 2016-4-7 22:42:57

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solala · 发表于 2016-8-16 16:45:01

不错，谢谢。。。

qxzszbs · 发表于 2016-9-6 08:41:26

正需要感谢，请问ddr3 用mig时 sys_clk能用no buffer吗？

xxxbano · 发表于 2016-9-10 01:56:59

thanks

shuwf · 发表于 2016-11-10 22:27:04

好东西啊，thanks~

ss3035 · 发表于 2017-2-20 16:25:28

filling water

ss3035 · 发表于 2017-2-20 16:28:14

filling water 2

ss3035 · 发表于 2017-2-20 16:33:41

make money

ss3035 · 发表于 2017-2-20 16:34:50

make money 2

ss3035 · 发表于 2017-2-20 16:46:16

filling water 3

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