SystemVerilog 验证方法学（教学视频 by eecourse）第一课

eecourse · 发表于 2016-1-15 14:54:49

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该课程讲解了用于设计验证的Systemverilog语言的入门与提高知识，是数字电路设计验证工程师需要掌握的基础核心知识理论。该课程不仅是对SystemVerilog语言元素的理论描述，更重要的是将SystemVerilog用于实际验证中的用法的归纳、总结和升华，通过对这门SystemVerilog培训课程的学习可以打好胜任asic/FPGA/SoC芯片设计验证工作的基础。

课程大纲

1. 验证的基础概念

2. 接口设计

3. 数据类型

4. 过程控制

5. 面向对象编程

6. 并发线程与控制

7. 随机化

8. 功能覆盖率

本次发布该课程第一课

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xdhuch · 发表于 2016-2-15 13:45:38

不错哦，这方面视频挺少的。谢谢！

603038276 · 发表于 2016-2-16 16:33:12

非常感谢，希望后续能有更多的课程分享。

yhsy1002 · 发表于 2016-2-24 18:46:55

这个可以有，现在这方面的资料很少

zhuzy618 · 发表于 2016-3-16 21:50:08

回复 1# eecourse

好好。。。。。。

liulihua2 · 发表于 2018-8-3 09:54:04

感谢！！！

BGbird · 发表于 2018-9-16 23:24:57

回复 1# eecourse

竟然还有课程了，好东西

月月鸟 · 发表于 2019-3-14 15:19:21

这个挺厉害了

oakay · 发表于 2020-10-27 15:37:30

.课程在哪儿?

wangheng1991 · 发表于 2020-11-6 16:23:17

谢谢楼主分享

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