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[求助] altera DDR3 SDRAM CONTROLLER 仿真

发表于 2015-11-22 14:01:38 | 显示全部楼层 |阅读模式

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altera DDR3 SDRAM controller IP 生成的仿真文件，在仿真的是否出现写数据的波形是这样的 FC%6X]5{((K[OZ6VK39I408.png

FC%6X]5{((K[OZ6VK39I408.png

DQS中间的时候为什么出现了一段未知，而且这个时候DQ还是有输入的？

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