Timing lib 和 cap table 之间对delay的贡献分别在哪一方面？

fu_wang · 发表于 2015-8-14 11:27:35

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最近在学flow上的问题，看到mmmc这边，首先考虑的是lib的load，其中有timing的信息，这一部分的timing信息是哪一部分？propagate? 然后在rc corner 这一部分的时候又提到captable 这种tech file，之前看STA的时候了解过这是一种计算cap，rising/falling slew等的（具体没有太细看，可能表达有问题）。那么除了extract RC 会考虑wire cap之外，它们分别计算的delay分别是指哪一部分？还是说要两者结合才能给出一个delay值？

korchagin · 发表于 2015-8-14 11:55:13

结合才能给出delay值，RC的计算是一个迭代过程

fu_wang · 发表于 2015-8-14 12:33:27

结合才能给出delay值，RC的计算是一个迭代过程
korchagin 发表于 2015-8-14 11:55

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thank you, one more question, 那么在timing lib上提供的timing 信息具体指的是什么？很多书上只是笼统的说了下提供timing的info 没有具体的解释，求大神解释一下～谢谢

korchagin · 发表于 2015-8-14 13:18:47

see static timing analysis in nano design

icfbicfb · 发表于 2015-8-14 14:41:10

多看点文档，感觉理解timing很混乱

fu_wang · 发表于 2015-8-14 15:37:02

多看点文档，感觉理解timing很混乱
icfbicfb 发表于 2015-8-14 14:41

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多谢版主提点，STA具体到delay的计算确实不熟，其实问题就是我想知道timing lib中timing 的信息是哪一部分？对计算delay 提供了什么数据？captable的东西？然后用于extract RC？

icfbicfb · 发表于 2015-8-14 17:55:45

就是cell rise/cell fall 这些，提供了查找表

其实原理不需要研究这么多，先把项目做完吧，

yic2000 · 发表于 2015-8-15 12:24:17

回复 5# icfbicfb

我想问问，net上的RC是不是对transition有贡献啊，比如driver的输出tran加上net的tran才是load输入的tran呢？

korchagin · 发表于 2015-8-15 12:44:16

回复 8# yic2000

当然有关系

yic2000 · 发表于 2015-8-15 14:10:21

回复 9# korchagin

我也知道有关系啊，具体是什么关系呢？

[求助] Timing lib 和 cap table 之间对delay的贡献分别在哪一方面？

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