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楼主: arszx

[求助] PHY芯片不用MAC可以用吗

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发表于 2015-8-16 10:01:40 | 显示全部楼层
发送时要加CRC的,否则接收端会丢掉的。
 楼主| 发表于 2015-8-17 17:18:01 | 显示全部楼层
回复 9# 挂在天边的鱼


   不好意思刚开始我没表达清楚,您最后的理解是对的,就是要把两块PHY的RGMII在FPGA内连接起来,一块负责接受数据,另一块负责发送数据,现在的问题是,用signaltap2可以捕捉到接收端的RXD信号,然后我把RX—CLK经过相位延迟的锁相环后送到发送端PHY,RXD送到TXD端,TX-EN我直接拉高了,问题就是数据发送不出去,phy的发送led不闪,并且在PC上也捕获不到发送信号。头疼死了,调了两周了,还是没结果,身边的人都不是搞FPGA的,也没个指导,已经丧失搞科研的信心了
 楼主| 发表于 2015-8-17 17:21:48 | 显示全部楼层
回复 10# iceblooming


   您好,我把两块PHY的RGMII在FPGA内连接起来,一块负责接受数据,另一块负责发送数据,现在的问题是,用signaltap2可以捕捉到接收端的RXD信号,然后我把RX—CLK经过相位延迟的锁相环后送到发送端PHY,RXD[3:0]送到TXD[3:0]端,TX-EN我直接拉高了,问题就是数据发送不出去,phy的发送led不闪,并且在PC上也捕获不到发送信号。用的DE2-115开发板,请问在FPGA内用控制MDC和MDIO口吗,不控制用默认的可以吗,如果必须要控制怎么设置啊,求助啊,救救我吧!
发表于 2015-8-17 22:00:19 | 显示全部楼层
关注,我也在考虑这方面的问题
发表于 2015-8-18 09:27:00 | 显示全部楼层
回复 13# arszx


    tx_en不能直接拉高的,你再看看rgmii接口协议,一般是先将rgmii转为gmii,再用一个异步fifo作为缓存,接收端时钟为rx_clk,发送端用时钟pll生成一个125M时钟
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