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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › CRC并行实现(Verilog)
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楼主: largedeer

CRC并行实现(Verilog)

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henryliu
发表于 2009-9-27 11:02:49 | 显示全部楼层
thanks!
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gascendcn
发表于 2009-9-27 11:09:48 | 显示全部楼层
thanks
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wangde03
发表于 2009-10-17 21:57:36 | 显示全部楼层
好的，！！！
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shuitian
发表于 2009-10-17 22:20:40 | 显示全部楼层
好东西哦，顶！
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thyears
发表于 2009-10-22 10:45:21 | 显示全部楼层
thanks for sharing!
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hujiaomianhao
发表于 2009-11-24 13:57:13 | 显示全部楼层
DDDDDDDDDDD
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omitofoo
发表于 2009-11-27 18:26:31 | 显示全部楼层
CRC并行实现(Verilog)
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songdj
发表于 2009-12-2 20:11:09 | 显示全部楼层
好东西啊
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philio
发表于 2010-1-20 16:30:40 | 显示全部楼层
hao dong xi
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icecream0518
发表于 2010-1-29 08:36:43 | 显示全部楼层
xiexielouzhu
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