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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › CRC并行实现(Verilog)

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楼主: largedeer

CRC并行实现(Verilog)

发表于 2010-1-29 12:06:44 | 显示全部楼层

好东西~~~~~~~~~~~~~~~~

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发表于 2010-1-29 14:04:01 | 显示全部楼层

1# largedeer
学习了！

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发表于 2010-1-31 23:25:14 | 显示全部楼层

謝謝分享

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发表于 2010-2-1 10:29:35 | 显示全部楼层

不知道怎么样

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发表于 2010-2-1 23:55:20 | 显示全部楼层

thanks

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发表于 2010-3-11 11:48:11 | 显示全部楼层

thanks

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发表于 2010-3-11 12:42:30 | 显示全部楼层

xue xi yia xia xia

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发表于 2010-3-22 09:39:15 | 显示全部楼层

本帖最后由 ai_jing 于 2010-3-22 09:41 编辑

恩，程序，下了瞧瞧。

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发表于 2010-3-22 18:48:16 | 显示全部楼层

thanks

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发表于 2010-4-11 16:01:15 | 显示全部楼层

xiexie louzhu

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