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请问华莱士树的4:2压缩器部分代码该如何写

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发表于 2007-4-17 12:27:00 | 显示全部楼层 |阅读模式

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我是个初学者,毕设题目是可重组的乘法器。4:2压缩器的原理弄明白了,可具体用verilog去实现却不知如何下手,请高手们帮帮忙,给我一些提示和指导。这里先谢过各位了
发表于 2007-5-16 00:33:02 | 显示全部楼层
一个全加器就是3-2压缩。
两个全加器就是4-2压缩
发表于 2008-1-14 21:46:37 | 显示全部楼层
应该说两个串行全加器是4:2压缩器!
发表于 2008-1-25 17:31:40 | 显示全部楼层
我这两天也是在研究这个问题,一直不是很理解4-2的压缩方法,还有,他的低一级的输出接到高一级的进位是怎么来连接的。。有点晕
发表于 2008-1-30 12:39:02 | 显示全部楼层
楼主。。我已经搞懂了4-2的压缩原理。。你可以参考一下 定点乘法器 蒋小龙的。。我觉得还写的比较详细。还有。。我前天已经上传了代码。。是我自己写的32bit乘法器,里面有用的4-2 压缩器。。希望对你有用。
发表于 2008-11-4 14:44:16 | 显示全部楼层

ok

一起加油!
发表于 2009-4-24 23:07:54 | 显示全部楼层
hua lai shi tree
发表于 2009-4-27 19:00:32 | 显示全部楼层
一个简单的图子说明一下,如果多位,可以以此类推……应该比较直观了:如图,4个2位的操作数经过压缩,变成了2个3位的数据,即:S[2:0],C[2:0],这2个数直接作为加法器的输入,即可得到最终结果。

[ 本帖最后由 rocky77 于 2009-4-27 22:43 编辑 ]
1.JPG
发表于 2009-4-27 19:01:55 | 显示全部楼层
呵呵,没装Visio软件,画的兔子太难看了。
头像被屏蔽
发表于 2009-5-1 20:41:33 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
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