place 之后cell 数量一下曾大很多一般会这样么如图

zhang60500827 · 发表于 2015-4-25 10:58:34

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icfbicfb · 发表于 2015-4-26 09:48:05

report_design -physical 看看， place完了会增加20~30%的cell instance count的

zhang60500827 · 发表于 2015-4-27 10:41:57

3q 大侠

zhang60500827 · 发表于 2015-4-27 13:37:23

主要是利用率一下子从65% 窜到了 85%

wzh27 · 发表于 2015-4-28 00:42:16

Check how many buffers have been added (11102-112=~11000), that may be caused by many many HFN (high fanout net) in your synthesize netlist.
2 reasons I can imagine:
(1) poor qualify of synthesize netlist. (Maybe max_fanout, max_cap or WLM are not set correctly)
(2) poor floorplan causes a lot for detour in trial route, which increases estimated wireload and buffers are needed by the tool.
I would check the (1) first.
FYI.

zhang60500827 · 发表于 2015-4-30 21:10:43

膜拜了大神前端 release 网表确实问题很多而且时序离约束差的很多 floorplan的话 design logic 比较简单 sram种类也很少我再跟 fe沟通下 3q

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