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查看: 5522|回复: 8

[求助] Cadence 环路仿真stb和开环AC仿真的GBW相差很大

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发表于 2015-4-1 17:28:10 | 显示全部楼层 |阅读模式

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在做运放环路仿真stb和开环AC仿真时的GBW相差很大,闭环36M,开环是114M。。。

开环

开环

闭环

闭环

                               
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闭环

闭环

开环

开环
发表于 2015-10-26 10:37:55 | 显示全部楼层
请问您解决了吗,我也遇到相同问题,不过我是单端的IPROBE。
发表于 2023-9-21 15:26:09 | 显示全部楼层
想问问是什么原因,遇到同样的状况
发表于 2023-10-21 16:11:10 | 显示全部楼层


gaodui 发表于 2023-9-21 15:26
想问问是什么原因,遇到同样的状况


请问解决了吗
发表于 2024-3-6 01:35:09 来自手机 | 显示全部楼层
同问,有没有大佬解答一下
发表于 2024-3-6 09:29:44 | 显示全部楼层


qqlpp 发表于 2024-3-6 01:35
同问,有没有大佬解答一下


开环和闭环的区别,看一下开环仿真时的输出DC点对不对,需要人为钳位一个dc电压。
发表于 2024-3-6 13:15:49 | 显示全部楼层
您用的是电容耦合的闭环仿真则,电容取的是大电容,AC仿真是 ,运放输入端是低阻节点,输出端是电容负载。
发表于 2024-3-6 13:17:06 | 显示全部楼层
闭环STB 仿真时,需要将反馈电容按米勒补偿的方式,折算到输入输出两端,此时,输入输出的极点特性,与AC仿真时不时再相同
发表于 2024-3-6 21:18:59 | 显示全部楼层
做了做仿真,个人认为stb仿真接成单位负反馈后,运放负输入端的栅电容加到输出负载电容上,gbw因此改变,可以减小输入管的cgg
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