[求助] encounter图形界面之后get_propagated_clock得到的时钟是ideal的

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zhanggd

发表于 2015-9-8 07:28:19 | 显示全部楼层

回复 5# dkslc

timingDesign之后查看报告,看clock network上的cell delay是不上0,如果是0的话就是ideal,如果不是0的话就是propagated的,在做完CTS之后一定要用set_propagated_clock [all_clock] 进行声明一下

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