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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › floorplan时power rail有几根异常
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查看: 1996|回复: 5

[求助] floorplan时power rail有几根异常

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hgd1505570
发表于 2014-10-11 21:34:21 | 显示全部楼层 |阅读模式

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本帖最后由 hgd1505570 于 2014-10-13 15:55 编辑

本人菜鸟一枚，做完AP，M8，M7，M6层的power strap后，插std filler，再preroute std生成rail，M2（rail 位于该层）有几条VDD比较异常，见下图，请教大牛们，这个是怎么回事，怎么解决，谢谢。

M2层rail

M2层rail
power

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jstaishi
发表于 2014-10-12 08:04:44 | 显示全部楼层
fill empty rows会做这样的事，看下出问题的地方有没有会导致这个option生效的地方吧
我也是新人，几条VDD可以手动吧，不过看着感觉你的孔也歪掉了，这个是什么情况
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icfbicfb
发表于 2014-10-12 16:17:31 | 显示全部楼层
少量的用手改吧
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yahemao123
发表于 2014-10-13 09:21:08 | 显示全部楼层
回复 3# icfbicfb


   此贴仅作者可见
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王不动
发表于 2014-10-13 13:32:15 | 显示全部楼层
这个有必要设置作者可见嘛。。。
这个是因为pin 的metal layer 和power 的power rail 的metal 冲突了，所以拉不到边上，能拉到边上的是因为没有冲突
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hgd1505570
 楼主| 发表于 2014-10-13 15:58:01 | 显示全部楼层
已手动改回，谢谢大家的回复
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