signalTapII 调试SDRAM没有时钟信号的问题

zd_2014 · 发表于 2014-9-10 15:45:27

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我在用signalTap调试SDRAM控制器时候，发现一个现象，调试结果应该是正确的，但是其中的SDRAM的时钟信号并没有出现，而是一直维持高电平。读写都正常，说明该时钟信号理应有变化的，但是却看不到，同样，Pll的输出也看不到信号变化 2014-09-10 15 47 59.jpg

还请明白的朋友，给释疑解惑一下，谢了。

zd_2014 · 发表于 2014-9-10 16:35:00

坐等坐等

plus · 发表于 2014-9-10 17:28:17

你的采集时钟每次都采到时钟的高电平

wgej1987 · 发表于 2014-9-12 10:12:13

自己采自己试试

cxhy · 发表于 2014-9-13 12:46:14

3L正解

Ahmed120 · 发表于 2014-9-14 01:27:57

非常有幫助

成长中的原始人 · 发表于 2014-9-18 09:47:47

采样时钟不能观察同频率的时钟的，PLL倍频一个时钟作为采样时钟就可以看到了

xushuai_hit53 · 发表于 2014-9-19 08:06:22

采样时钟过慢

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