使用DC来综合异步电路？

dfx9230 · 发表于 2014-6-23 12:47:56

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请问异步电路能使用DC来综合吗，端口没有clock，输入靠WE的上升沿的latch，输出靠RE的上升沿来latch，这样的电路代码能综合吗，能否将WE 和 RE 看做是clock，来进行约束？谢谢！

picometer · 发表于 2014-7-24 11:45:19

没有人来回答。
我也想问同样的问题

bukubuku · 发表于 2014-7-31 11:07:23

可以综合，如果没有时序要求的话可以不加约束，靠设计避免violation，跑后仿真，小心处理

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