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查看: 4310|回复: 8

[求助] 改变OPENCORE上的UART16550中 FIFO 大小

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发表于 2014-3-24 15:44:48 | 显示全部楼层 |阅读模式

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小弟最近在使用OPENCORE上的UART16550内核,发现自带16字节的FIFO不够用,现在想把FIFO大小改成32字节,请大家帮帮我好吗,已经困扰我好久了,verilog hdl公司里没有人会,所以根本没有人能帮到我,各位高手帮帮忙,附件里有源代码


uart16550.rar (39.16 KB, 下载次数: 92 )
发表于 2014-11-13 20:49:07 | 显示全部楼层
xie xie !
发表于 2014-11-21 16:12:26 | 显示全部楼层
还收费啊啊啊
发表于 2015-8-30 16:45:58 | 显示全部楼层
不知道你的问题解决了没有,我今天刚看到这个IP核,你是不是fifo[0] <= #1 0;
                fifo[1] <= #1 0;
                fifo[2] <= #1 0;
                fifo[3] <= #1 0;
                fifo[4] <= #1 0;
                fifo[5] <= #1 0;
                fifo[6] <= #1 0;
                fifo[7] <= #1 0;
                fifo[8] <= #1 0;
                fifo[9] <= #1 0;
                fifo[10] <= #1 0;
                fifo[11] <= #1 0;
                fifo[12] <= #1 0;
                fifo[13] <= #1 0;
                fifo[14] <= #1 0;
                fifo[15] <= #1 0;之后没有初始化呢?而且bottom <= #1 1‘b0;也应该改成bottom                <= #1 0吧;
发表于 2016-6-13 20:53:09 | 显示全部楼层
用的什么芯片?
发表于 2018-12-17 14:44:18 | 显示全部楼层
发表于 2018-12-17 17:16:16 | 显示全部楼层
发表于 2020-8-28 17:08:53 | 显示全部楼层
发表于 2020-8-31 13:21:56 | 显示全部楼层
你这求助咋还收费。。。
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