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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › layout面积缩减
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查看: 1398|回复: 1

[求助] layout面积缩减

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gmt971
发表于 2014-2-21 20:40:05 | 显示全部楼层 |阅读模式

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求教layout面积缩减的相关经验。谢谢！
layout, layout

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piao
发表于 2014-3-4 23:19:13 | 显示全部楼层
1)  process shrink, then you can shrink the layout at least for the logic circuit.
2) try to understand the requirement, then you can have better idea to shrink the layout
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