place完成后如何分析timing

xingyun666666 · 发表于 2016-2-29 16:11:06

回复 2# renhonglei

你就瞎说

Nora_Lee · 发表于 2018-11-12 16:34:13

回复 7# smartyaya

place 后 clock skew 都是0呀

shenteng · 发表于 2018-12-14 15:29:09

回复 7# smartyaya

这个clock skew有毛关系，这才是place阶段，一般这个阶段timing是很clear的，因为clock有时ideal的，如果有很大的violation，那就是interface的问题或者是design设计的有问题。

whyeah · 发表于 2021-2-9 12:17:49

jiancongwoo 发表于 2013-12-25 21:44
我来回答下吧！(以下命令基于ICC，如果用到是EDI，请参考EDI的user guide，找出对应的命令)
1.check_timing ...

QoR是啥意思啊？

西顾 · 发表于 2021-3-14 15:49:24

whyeah 发表于 2021-2-9 12:17
QoR是啥意思啊？

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