encounter traile与nano 线网open问题

jianyuefei · 发表于 2013-9-20 10:14:42

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各位同学，吾在试用encounter预布线流程时碰到个问题，折腾了2天亦还没得到解决，希望能得到高手们的帮助。
先预布了一个不带sdc约束的top级的网表，发现对里边涉及到1'b1、1'b0接一些buf或inv的栅的单元，其输入端确实接到了TIEHHD，或TIELHD的输出“Z”了，但是这些buf或inv的输出却是open的，我作的排查步骤如下1：利用encounter的verify工具检查lvs,发现是oK的，没有报 buf与inv的open错误；2：对encounter吐出的网表检查，查这些buf或inv的输出，也确实存在连接关系，而非open，也就是说输入的.v网表与输出的.v网表没有变化。3：对给出的top.v，单独对预布其top中的子模块，其在top级中出错的单元在子模块中又是OK的。各位高手，像这个问题，可能出错的环节在那儿，或者排查问题还有那些？请高手们给点建议，谢谢！！！

jianyuefei · 发表于 2013-9-20 22:15:42

funk:，没人回啊？

jianyuefei · 发表于 2013-9-21 19:31:11

有没有可能本来给出的网表有问题呢？

[求助] encounter traile与nano 线网open问题

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