ALTERA 调用MODELSIM的问题

djqlyy · 发表于 2013-8-30 10:12:12

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建了两个完全一样的工程，工程中调用一以太网的IP核名字为ETH，在一个工程中编译仿真完全正常，
在另一个工程中编译正常，仿真却出现下面的错误！！！
** Error: (vlog-7) Failed to open design unit file "E:/HW/FPGA/HW/ETH.vo" in read mode
我真是奇了怪了，仿真是QUARTUS自动调用的，路径没有问题，别说汉字空格下划线都没有，
另外那个完全正常的工程中也没有ETH.VO这个文件，真不明白这是什么玩意！！！！

heaoo · 发表于 2013-9-3 21:29:10

常的工程中也没有ETH.VO这个文件，真不明白这是什么玩意！！！！

加油99 · 发表于 2013-9-5 12:55:26

本帖最后由加油99 于 2013-9-5 12:57 编辑

.vo是Quartus为仿真产生的，通常在......\simulation\modelsim\目录中。

edwardk · 发表于 2018-12-19 14:42:28

学习中。。。。。

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