如何用ALTERA的PLL输出差分时钟？？？

wgang0224 · 发表于 2013-8-9 16:47:42

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我想要FPGA输出一对300M的差分时钟，
先用PLL倍频出一个300M时钟，

我不知道怎么把这个时钟和FPGA的PLL_CLKOUTp和PLL_CLKOUTn联系起来

pllout

图中的PIN_144和PIN_143是PLL_CLKOUTp和PLL_CLKOUTn。
怎么设置让这两个引脚输出PLL生成的300M时钟。

wgang0224 · 发表于 2013-8-9 16:51:07

补图1：

wgang0224 · 发表于 2013-8-12 08:54:47

有没有人知道怎么弄啊？

xxxyyy114 · 发表于 2013-8-12 14:12:19

本帖最后由 xxxyyy114 于 2013-8-12 14:13 编辑

回复 3# wgang0224

对于差分引脚，只需要指定信号到正极引脚。如果正极引脚被指定为差分I/O 标准，那么Quartus II 会自动指定负极引脚。
所以呢，你只需要将PLL的输出C0 分配到PLL_CLKOUTp,然后设置PLL_CLKOUTp 为差分IO，quartus II就会自动处理PLL_CLKOUTn，让PLL_CLKOUTp和PLL_CLKOUTn成为差分模式的IO

wgang0224 · 发表于 2013-8-14 15:25:20

回复 4# xxxyyy114

谢谢

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