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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › enounter导出的SDF与verilog文件做pt出问题
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[求助] enounter导出的SDF与verilog文件做pt出问题

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hbbdlx
发表于 2013-7-27 20:58:45 | 显示全部楼层 |阅读模式

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我用encounter导出了sdf和spf文件和同是encounter导出的netlist文件来做pt的版图后仿真，可是pt却报告在netlist里找不到一些sdf里有的pin,用一个encounter设计里导出的sdf和netlist为什么有些器件不一样呢？
出现这样的问题要怎么解决？
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