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lunluoren8 · 发表于 2013-6-26 16:26:39

好多好全！支持下

gxlong · 发表于 2013-6-27 22:47:20

支持一下，3Q

gxlong · 发表于 2013-6-27 23:10:31

很不错的说

ZDHCUMT · 发表于 2013-6-28 21:56:46

非常感谢，很好

yanfan1987 · 发表于 2013-6-30 17:47:51

东西是好，就是好贵啊。。。。

14072083 · 发表于 2013-7-1 18:40:47

正需要多谢

scu_lin · 发表于 2013-7-5 08:14:59

duoxie louzhu fenxiang

yangxueboily · 发表于 2013-7-5 08:55:00

要好好学一下，挺有用的貌似

zjt412 · 发表于 2013-7-10 20:41:17

请问我在用ICC做lab的时候，lab1里add RISC_CHIP.v时，会出现3个error。
Error: Module 'ad01d0' is not defined. (MWNL-297)

Error: Verilog parser cannot parse the /home/zhangjt/IC_Compiler_2010.03-SP2/lab1_data_setup/design_data/RISC_CHIP.v source file. (MWNL-047)
No such file or directory

Error: Current design is not defined. (UID-4)

求解？？？？？？

Syn2012 · 发表于 2013-7-10 23:11:58

多谢分享！

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