mash111 sigma delta pll 问题求教

superspy007 · 发表于 2013-5-7 13:15:08

回复 10# scpuke

多谢帮助，我按照你的思路试验一下，有问题再请教

superspy007 · 发表于 2013-5-7 16:00:48

回复 10# scpuke

关于你说的验证方法，我还有两个问题
1.关于DSM的仿真，通常我们是输入正弦波做fft看频谱的，但是这个输入是数字信号呀，我想可不可以这样我直接给一个一定周期的数字信号，然后直接在cadence里做dft，如果频谱正确的话就证明DSM设计正确。
2. 你说的关于divider 和DSM何时loading 分数分频的问题，没理解，我如何仿真观察出何时的loading time？

神盾 · 发表于 2013-5-8 11:28:56

回复 1# superspy007

是将所有的输出与整数相加得到时事的分频比啊，有三位的~~

wangyanhustdk · 发表于 2015-5-22 16:20:58

回复 5# superspy007

你好，我想知道这个问题是怎么理解的？谢谢！

danglang · 发表于 2016-7-12 21:23:18

回复 10# scpuke

你好，请教一个问题。
为什么dms的时钟要选择divider的输出，而不能直接选择参考时钟？

scpuke · 发表于 2016-7-14 15:05:52

回复 scpuke

你好，请教一个问题。
为什么dms的时钟要选择divider的输出，而不能直接选择参考 ...
danglang 发表于 2016-7-12 21:23

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时序的问题：divider完成一次除N后，需要SDM更新下一个N值。用divider的输出时钟作为SDM的时钟，可以确保divider与SDM之间的数据交互时时序是正确的。
如果是参考时钟作为SDM的时钟，在PLL还没有锁定时，参考时钟与Divider输出时钟相位关系还不确定，那么divider去加载SDM的N值时是无法保证时序的，可能加载到错误的N值。

windwithgone · 发表于 2016-9-24 21:26:00

回复 16# scpuke

Scpuke果真大神，学习了。🤣🤣

sp065441 · 发表于 2018-5-12 02:00:25

回复 16# scpuke

學習了

曾宝荣 · 发表于 2019-4-10 21:00:39

superspy007 发表于 2013-4-15 08:47
回复 7# dodo4599

请问mash111的输出范围为什么是[-3:4]呀，怎么算的呀，我也觉得是【-2,3】呀。。。

春江随缘 · 发表于 2019-4-22 17:23:31

曾宝荣发表于 2019-4-10 21:00
请问mash111的输出范围为什么是[-3:4]呀，怎么算的呀，我也觉得是【-2,3】呀。。。
...

Cn 0~1 ， Cn（1-z-1）-1~1，Cn（1-z-1）2 -2 ~2

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