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[资料] systemverilog验证:测试平台编写指南英文原版

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发表于 2013-3-13 21:03:17 | 显示全部楼层 |阅读模式

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好东西吧,原版看起来还是要比中文的舒服,我就不多说了,自己看着下吧

SystemVerilog+for+Verification%283rd%29.pdf

10.01 MB, 下载次数: 1209 , 下载积分: 资产 -4 信元, 下载支出 4 信元

发表于 2013-3-14 17:16:47 | 显示全部楼层
好东西,正好对验证的知识匮乏,和验证组的交流也会有问题
发表于 2013-5-27 22:53:55 | 显示全部楼层
好东西,收下了
发表于 2013-5-28 14:31:02 | 显示全部楼层
感谢分享
发表于 2013-5-31 13:38:13 | 显示全部楼层
回复!!!!!!!!
发表于 2013-6-1 22:19:54 | 显示全部楼层
感谢感谢
发表于 2013-6-7 16:27:59 | 显示全部楼层
非常感谢,看了中文书籍 现在看看英文版
发表于 2013-8-7 14:31:01 | 显示全部楼层
回复 1# justice9852


   感謝樓主分享好書
发表于 2013-8-9 22:57:36 | 显示全部楼层
学习学习了
发表于 2013-8-18 14:15:58 | 显示全部楼层
非常感谢!楼主能给个中文版的不?谢谢!
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