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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › 【求助】Estimated I/O latency问题

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查看: 2236|回复: 5

[求助] 【求助】Estimated I/O latency问题

发表于 2012-12-16 15:24:24 | 显示全部楼层 |阅读模式

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本帖最后由 Alicezw 于 2012-12-17 19:44 编辑

看Timing Constraints and Optimization User Guide时遇到一个不解的问题。
estimated I/O latency时，为什么对setup和hold分析会因input或output Paths而不同？
希望可以得到大家的指点。非常感谢！

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发表于 2012-12-16 22:50:53 | 显示全部楼层

将外部的delay看作一条普通的path来理解就比较清楚了。也就是说有一个虚拟的片外寄存器做为startpoint 或者 endpoint。

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楼主| 发表于 2012-12-17 08:51:28 | 显示全部楼层

回复 2# 205207033

哦，谢谢您的解答。
可是为什么作为input或output Paths，工具会分析地不一样呢？
可能是我理解有问题，希望您能给予一些帮助。非常感谢！

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楼主| 发表于 2012-12-17 08:53:35 | 显示全部楼层

回复 2# 205207033

哦，谢谢您的解答。
可是为什么作为input或output Paths，工具会分析地不一样呢？
可能是我理解有问题，希望您能给予一些帮助。非常感谢！

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楼主| 发表于 2012-12-17 14:32:02 | 显示全部楼层

哎呀呀！不能就这么沉了啊。可能很简单，但是请讲解一下吧。谢谢各位了！

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发表于 2013-6-22 08:27:18 | 显示全部楼层

受教了

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