VCS仿真流程

lvmingfiona · 发表于 2012-12-3 18:24:59

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有哪位高人，可以介绍一下VCS的仿真流程，就是它对一段verilog代码是怎样编译，执行的，谢谢！

zzj0329 · 发表于 2012-12-4 13:11:20

编译？
那你还是用DC或者FPGA的一些工具才能编译（其实应该叫综合的）

lvmingfiona · 发表于 2012-12-4 15:23:38

回复 2# zzj0329

前辈，我其实想问的是VCS的仿真机制，就是它怎么工作的，忘能指导一二！多谢

jrmjrf · 发表于 2012-12-4 21:17:25

VCS本身有一些库，这些库是的作用是将您写的Verilog或者Vhdl中的一些关键字能翻译成理想的电路。在您加入testbech后，它就会根据您代码仿真出输出波形，如果输出波形如您设计时所想的波形是一致的话，说明您的设计在功能上市正确的，但是注意，仿真时还没有将您的设计映射成具体的工艺，是与工艺无关的。

lvmingfiona · 发表于 2012-12-5 08:02:28

回复 4# jrmjrf

非常感谢~~

飞扬紫百合 · 发表于 2012-12-5 10:10:12

The Compilation on VC is very diferrent from that on FPGA or DC tools!
FPGA and DC tools is better!
VCS is just for simulation as your TB in Verilog language on modelsim and FPGA tools!

lsl_2010 · 发表于 2012-12-6 14:27:30

VCS本身有一些库，这些库是的作用是将您写的Verilog或者Vhdl中的一些关键字能翻译成理想的电路。在您加入te ...
jrmjrf 发表于 2012-12-4 21:17

登录/注册后可看大图

学习了

260000 · 发表于 2012-12-7 11:47:42

同求

see123 · 发表于 2012-12-7 12:29:07

说明您的设计在功能上市正确的，但是注意，仿真时还没有将您的设计映射成具体的工艺，是与工艺无关的。

zqtiege · 发表于 2013-3-31 10:41:49

谢谢哈，

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