关于synopsys的gtech.db

Gary.wang · 发表于 2012-11-9 18:38:00

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这个库是干什么用的？

为什么我DC综合出来的网表在时钟模块里面有很多gtech_**的cell?而没有用target library的cell?

多谢~~

Gary.wang · 发表于 2012-11-9 18:42:14

比如我的一个clock and gate综合后就是
GTECH_AND2 ()
为什么不调用target lib里面的cell呢？奇怪！！！

Gary.wang · 发表于 2012-11-9 18:56:14

问题找到了，我把clock module这个模块设置了dont_touch；
但是为什么设置这个属性后，连lib里面的cell都不会调用了呢？

284294022 · 发表于 2012-11-21 20:21:04

回复 3# Gary.wang

LZ，GTECH的库在哪能找到呢？另外，你的问题，我猜你先综合那个module，再dont touch

我最近才开始学dc

Gary.wang · 发表于 2012-11-21 21:30:01

回复 Gary.wang

LZ，GTECH的库在哪能找到呢？另外，你的问题，我猜你先综合那个module，再dont touch
...
284294022 发表于 2012-11-21 20:21

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在synopsys目录下面找找

wohewangke · 发表于 2012-11-21 21:58:10

难道设置dont_touch属性之后，就不会Mapping到target library了？

Gary.wang · 发表于 2012-11-21 22:09:21

难道设置dont_touch属性之后，就不会Mapping到target library了？
wohewangke 发表于 2012-11-21 21:58

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是的，你可以实验一下！

HADIST · 发表于 2013-5-18 22:23:39

回复 7# Gary.wang

啊？ dont touch不是不让优化clock路径么？和库有什么关系？

Gary.wang · 发表于 2013-5-20 09:23:20

回复 Gary.wang

啊？ dont touch不是不让优化clock路径么？和库有什么关系？
HADIST 发表于 2013-5-18 22:23

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是这样子的。你可以试试。

trippa · 发表于 2013-5-20 19:16:23

getch.lib是synopsy公司开发的与工艺无关的工艺库。在dc时dc首先将RTL代码转换为通用的布尔表达式，就是getch格式，这个是与工艺无关的，在执行compile命令以后DC按设计约束使用目标库的逻辑单元映射成门级网表。估计你的问题是链接库设置对，你在试一下。

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