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[原创] SystemVerilog经典教材

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发表于 2012-9-17 15:12:45 | 显示全部楼层 |阅读模式

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SystemVerilog已经成为IC验证的王牌工具,而在很多设计当中,sv也是作为设计语言出现的
很辛苦找来的资料,非常清晰,与各位IC同志共勉

SystemVerilog_3.1a.pdf

4.05 MB, 下载次数: 562 , 下载积分: 资产 -3 信元, 下载支出 3 信元

发表于 2012-9-18 19:26:16 | 显示全部楼层
这个可以有~~~~
发表于 2012-9-21 14:10:39 | 显示全部楼层
LS威武 支持下
发表于 2012-9-21 21:50:58 | 显示全部楼层
谢谢....
发表于 2012-9-21 23:45:58 | 显示全部楼层
就是systemverilog的语言参考手册吧
发表于 2012-9-22 09:50:26 | 显示全部楼层
reference manual !
发表于 2012-9-27 16:03:18 | 显示全部楼层
下资料留名!
发表于 2012-10-2 13:21:58 | 显示全部楼层
eetop
发表于 2012-10-2 23:28:36 | 显示全部楼层
回复 1# haitaox


    是的是的!
发表于 2012-12-20 23:19:26 | 显示全部楼层
谢谢楼主的分享
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