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[求助] verilog 笔试题 求助

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发表于 2012-8-17 11:11:44 | 显示全部楼层 |阅读模式

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遇到一个不会的笔试题  求助网友
A :8bit unsigned number
B :8bit signed number (2' complementary code)
用verilog实现加法功能
欢迎讨论
发表于 2012-8-17 12:16:50 | 显示全部楼层
将B和A按位扩展为10位(有符号位),A转换为signed表示,然后进行加法运算。。。。
 楼主| 发表于 2012-8-17 12:31:13 | 显示全部楼层
回复 2# jefby


    那为何要扩展是10位? 9位不就可以了?
B为补码 补码怎么扩展? signed转换,不可以综合吧?
发表于 2012-8-17 14:18:01 | 显示全部楼层
回复 1# lyz5432


    将A和B的高位扩展一位相加,结果为9位有符号数。可以仿真一下
发表于 2012-8-17 14:21:39 | 显示全部楼层
回复 3# lyz5432

A加上符号位就是9bits,那么A加B就有可能是个10位的带符号数。
补码扩位,高位补符号位,再相加,结果是补码(有符号)。
发表于 2012-8-17 14:38:23 | 显示全部楼层
回复 5# otogyg


    那是理论看上去的样子,两个八位无符号数相加最大的结果也才是九位数。另一个数是有符号数,那结果就更不好超过九位了。
发表于 2012-8-17 14:57:08 | 显示全部楼层
回复 6# zongkai2003
你没把符号位算进去吧。。
发表于 2012-8-17 15:09:27 | 显示全部楼层
考虑两个极端
A=255,B=127,A+B=385
A=0,B=-128, A+B=-128
所以9位有符号数足够了
发表于 2012-8-17 15:36:13 | 显示全部楼层
回复 8# zongkai2003
9位有符号数表示的范围是: -256到255。。
发表于 2012-8-17 17:46:57 | 显示全部楼层
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