全差分运放摆率建立时间输入共模范围输出摆幅仿真

bobby2050 · 发表于 2012-8-7 19:07:21

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设计的全差分运放，如何在Cadence中搭建仿真电路去仿真【摆率】【建立时间】【输入共模范围】【输出摆幅】？还请做过全差分运放的同仁，画个草图传上来，单纯的文字语言显得晦涩难懂，希望大家能指导我，谢过。PS：论坛中搜过的资料，我想能看懂的同仁绝对比我聪明。

feynmancgz · 发表于 2012-8-7 19:31:24

回复 1# bobby2050

希望这三个文献对你能有所帮助

bobby2050 · 发表于 2012-8-7 21:05:31

谢谢，有一些收获。其他人能否在帮帮我啊，师父请不吝赐教，谢谢啦。

frankobvip · 发表于 2012-8-31 11:02:46

回复 2# feynmancgz

3q

scorpius_ice · 发表于 2012-9-5 15:47:20

多谢多谢

kkman78 · 发表于 2012-9-13 01:19:48

duo xie, duo xie

mcgrady · 发表于 2012-9-15 23:54:53

回复 2# feynmancgz

收藏了，谢谢
突然发现版主的图像原来是鼎鼎的steyaert... 版主是他学生吗？
JSSC上的照片好年轻

feynmancgz · 发表于 2012-9-16 01:06:25

回复 8# mcgrady

哦，我不是的他的照片都很年轻，他现在头发，眉毛都白了些，虽然只有50多岁

zm19870610 · 发表于 2012-9-19 16:21:04

好东西，下来看看

windstone · 发表于 2012-9-20 00:20:13

很想看看，可是没钱

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