modelsim版本不同仿真不同吗

qwertyuiop1234 · 发表于 2012-7-27 19:41:06

mark mark

lara9554 · 发表于 2012-7-28 22:04:15

如果你的语法正确，仿真结果应该一样

陶志妖妖 · 发表于 2012-7-29 14:15:21

回复 22# lara9554

恩，是的。现在好了，原因是新版本modelsim配置文件中将优化没有去掉。

jackertja · 发表于 2012-7-30 11:12:15

回复 23# 陶志妖妖

不要在两个always里对同一个信号赋值。
千万不要。
即使在TB里也不要。
养成好习惯，否则吃大亏。

poiu_elab · 发表于 2012-7-30 13:46:51

还真有可能

s19812500 · 发表于 2012-7-30 22:27:44

学习中！

qwpsmile · 发表于 2012-7-30 23:12:07

最好还是一个 sequential always 对应一个 variable，不容易出问题，也就省了多天的折腾。

billy_hr · 发表于 2012-7-31 18:00:18

24L正解，先去看看代码风格，仅能编译通过的Verilog离真正的硬件还有段距离。

xiaofeng2001 · 发表于 2013-3-8 10:11:26

这个是有问题的，ram1_addra出现在两个always的块中，这就算仿真通过了，在ise中综合也会通不过的，需要好好的更改自己的编程风格，这个可以参考华为的编程规范

cbg · 发表于 2015-5-29 15:29:00

学习了，编码风格

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