设为首页收藏本站
在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名：电子顶级开发网)

手机号码，快捷登录

手机号码，快捷登录

找回密码

  登录   注册  

快捷导航
创芯云服务  : 创芯大讲堂  | 创芯人才网 | 数字IC职业培训  EETOP诚邀线上IC培训讲师!
搜帖子
EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › **writing testbench** Functional verification of HDL ...
12
返回列表 发新帖
楼主: IC_panda

[资料] **writing testbench** Functional verification of HDL models 2nd edition

[复制链接]
jimcmwang
发表于 2019-6-2 09:22:33 | 显示全部楼层
您的 资产 -3 信元, 下载支出 3 信元 ，现在将开始下载“Writing_testbenches_2rd.pdf”
回复 支持 反对

举报

jimcmwang
发表于 2019-6-2 09:23:06 | 显示全部楼层
谢谢分享！！！！！！
回复 支持 反对

举报

smh
发表于 2020-2-24 11:05:31 | 显示全部楼层
thankns
回复 支持 反对

举报

cong_plus
发表于 2020-3-18 16:34:02 | 显示全部楼层
thanks a lot tr
EETOP创芯人才网职位发布入口
回复 支持 反对

举报

12
返回列表 发新帖
高级模式
B Color Image Link Quote Code Smilies
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条

小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-18 05:59 , Processed in 0.016762 second(s), 5 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表