IUS仿真用电容器件求助

robberxiong · 发表于 2012-6-6 14:32:26

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用Verilog-A写了一个电容模型，然后生成一个symbol，用cadence AMS仿真，在creat netlist时报错
ncvlog: *E, NOTCMP: unit cap not found while paring.
Fail to compile.
请问这个错误是怎么造成的？有人说是需要修改CDF属性，如果是CDF属性问题，怎么修改自己写的电容模型的CDF属性？

ricvadim · 发表于 2020-3-21 21:16:44

非常感谢。我们期待着继续

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