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我想请问各位大虾:
我用FPGA设计实现一个加法器,里面的逻辑单元的个数已经确定。如下所示:
total logic elements :57
total combinational funtions:57
dedicated logic registers:20
total registers:20
total pins:42
total virtual pins:0
total memory bits:0
embedded multiplier 9-bit elements:0
total PLLs:0
请问,每个这里的逻辑单元的面积是多少呢?我想确定最后用FPGA实现的总的面积?
非常感谢!!! |
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