system verilog 怎样打印接口信号？

ck040521 · 发表于 2012-4-10 15:23:20

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如题，
本人正在学习system verilog验证，现在发现使用 interface 后，就不能在fsdb里加载端口信号了。
特向各位求助！！！

系统任务如下：
initial
begin
$fsdbDumpfile("test.fsdb");
$fsdbDumpvars(0,top,"+all");
end

lanting1988 · 发表于 2012-4-20 15:12:06

搭车同求！

zzczx · 发表于 2012-4-20 21:31:35

看interface里面

soc_apple · 发表于 2012-4-23 12:04:30

interface模块可以看

ck040521 · 发表于 2012-4-24 15:36:58

回复 4# soc_apple

需要添加什么参数么，interface里的信号还是看不了啊？

ck040521 · 发表于 2012-4-24 15:38:51

top
interface
dut
test
组织是这样的

soc_apple · 发表于 2012-5-4 11:09:02

你用的是mentor的吧？这个我不太记得了，VCS的是可以的，启动DVE后，在top下面会有一个interface的例化名，可以像看其它模块波形一样直接看信号波形的。Mentor的应该也能支持的

ck040521 · 发表于 2012-5-4 16:56:04

vcs_mx 编译仿真，执行系统任务打印fsdb波形文件后用verdi 是看不到的。

另外使用dve的确可以看到,需要添加系统任务$vcdpluson;产生vpd文件。
Thx all the same!!

天地容我心 · 发表于 2012-9-8 10:41:23

不错。。。。

feng841210 · 发表于 2012-9-9 12:17:38

这个以前真没留意过啊！

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