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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › DC综合之时序约束，公司内部解密
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楼主: graduate2010

[资料] DC综合之时序约束，公司内部解密

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lzj94412768
发表于 2012-8-14 10:25:45 | 显示全部楼层
xxxxxxxxxx
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benny46
发表于 2012-8-14 17:26:22 | 显示全部楼层
很老很老的文件了
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dwm1235
发表于 2012-8-14 22:58:01 | 显示全部楼层
zanyige
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xuevic
发表于 2012-8-21 08:11:36 | 显示全部楼层
值得学习
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dx232110
发表于 2012-8-28 16:24:42 | 显示全部楼层
好东西 学习学习
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mouchenjie
发表于 2012-8-29 09:46:08 | 显示全部楼层
学习学习。。。。
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cleveland2002
发表于 2012-8-29 11:12:27 | 显示全部楼层
似乎不错，值得一看，收下！
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hubeiwen_icc
发表于 2012-8-29 16:07:24 | 显示全部楼层
下来看看，学习下
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zzhxll10081
发表于 2012-8-30 15:31:01 | 显示全部楼层
好东西，学习学习
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robberxiong
发表于 2012-8-31 21:57:34 | 显示全部楼层
骗子啊！是FPGA的东西，还是赛灵思的培训文档
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