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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › DC综合之时序约束，公司内部解密
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楼主: graduate2010

[资料] DC综合之时序约束，公司内部解密

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wyb1117
发表于 2017-8-18 22:35:42 | 显示全部楼层
多谢!!!!!!
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sunflower_csy
发表于 2017-8-19 11:30:25 | 显示全部楼层
学习学习
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Mandolin
发表于 2017-9-1 21:28:59 | 显示全部楼层
新人学习
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Ryggeor
发表于 2017-9-1 22:37:46 | 显示全部楼层
thnx!
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一路向前
发表于 2017-9-9 13:23:16 | 显示全部楼层
好东西，学习
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eaglesmiling
发表于 2017-9-9 17:27:24 | 显示全部楼层
回复 1# graduate2010


   Xilinx 的时序约束。公司内部解密
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raino
发表于 2017-9-9 19:10:34 | 显示全部楼层
下载了看看
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luei1987kg
发表于 2017-9-13 15:28:57 | 显示全部楼层
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luei1987kg
发表于 2017-9-13 15:31:00 | 显示全部楼层
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mcsino
发表于 2018-2-27 16:57:08 | 显示全部楼层
收了收了~~~~~
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