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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › Verification Methodology Manual for SystemVerilog
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楼主: pipiw

Verification Methodology Manual for SystemVerilog

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proud_li
发表于 2007-1-20 13:04:34 | 显示全部楼层
没有钱了,等会儿 再来下
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damige
发表于 2007-1-23 22:54:20 | 显示全部楼层
看上去还不错，这就去仔细阅读一下
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verifyboy
发表于 2007-2-2 02:30:50 | 显示全部楼层
感谢楼主！！
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lxc531
发表于 2007-2-2 10:50:22 | 显示全部楼层
非常感谢楼主
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我是浪子
发表于 2007-2-2 14:05:21 | 显示全部楼层
不知道systemVerilog和systemC那个会推广。
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huangma
发表于 2007-2-5 19:08:32 | 显示全部楼层

hao

very nice!
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ydfs
发表于 2007-2-8 19:32:31 | 显示全部楼层
我终于找到了。。。。。
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windwine
发表于 2007-3-6 04:09:26 | 显示全部楼层
看上去还不错
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nativeda
发表于 2007-3-12 00:00:37 | 显示全部楼层
是本好书，如果上载的时候能把索引文件也放进来就更加好了，呵呵
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shangang
发表于 2007-4-11 12:48:11 | 显示全部楼层
安装VCs后街有这个文件
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