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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › ASIC后端设计中的时序偏差以及时钟树综合 ...
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楼主: johnny1209

[资料] ASIC后端设计中的时序偏差以及时钟树综合

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cadance
发表于 2012-8-2 22:35:00 | 显示全部楼层
thanks for shairng
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calviny83
发表于 2012-8-7 11:41:59 | 显示全部楼层
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abc_def_ghi
发表于 2012-8-8 14:04:51 | 显示全部楼层
时钟最重要了
学习
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houyaowei123
发表于 2012-8-20 23:49:50 | 显示全部楼层
挺好的
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young17er
发表于 2012-8-24 22:02:32 | 显示全部楼层
好好学习下！
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young17er
发表于 2012-9-22 23:34:01 | 显示全部楼层
感谢~
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young17er
发表于 2012-9-28 22:37:30 | 显示全部楼层
多谢交流。
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HP_ccyz2012
发表于 2012-9-29 10:15:17 | 显示全部楼层
顶一个，看看
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hiyoun
发表于 2012-10-4 11:45:43 | 显示全部楼层
下来看看
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freeman_zp2012
发表于 2012-10-6 11:21:00 | 显示全部楼层
回复 1# johnny1209


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